基于FPGA的PWM与定时计数器IP核的设计

kenson

基于FPGA的PWM与定时计数器IP核的设计

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可提高嵌入式混合信号应用灵活性的PWM IP核
, k: F% D* ^- W  i, o5 Y( KActel低成本的CorePWM IP核这是为Actel公司的FPGA而优化、针对数摸转换而设的灵活脉冲宽度调制(PWM)IP核。在应用于Actel的Fusion可编程系统芯片(PSC)时,CorePWM能实现单芯片闭环控制系统的设计,有助于减少部件数目和提高灵活性。CorePWM可让系统设计人员在单芯片FPGA上实现高度集成的精密控制和转换系统,进一步为嵌入式设计人员开辟全新的发展空间。而且,CorePWM和Actel Fusion的结合,可替代现有的分立PWM元件、ASSP或ASIC器件,为那些要求小体积、低功耗和低成本的应用带来优势。
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( @. l1 o- |" {. U, W- [# C7 M  x这款CorePWM IP核的逻辑门资源占用量小,仅是3万个逻辑门ProASIC3的11%,或9万个逻辑门Fusion器件的4%。该IP核可以提供寄存器接口,既可应用于无控制器的设计也可以与微控制器如Actel的Core8051或CoreMP7一起工作。CorePWM可提供精度可达8位的8个通道的PWM的输出,以及一个8位的Prescaler,其用于Fusion器件的时钟速度为98MHz,可在各种嵌入式应用中使用,包括加热和冷却、电机控制、运动控制、电压输出调节和声音生成。其他支持全新CorePWM核的Actel FPGA器件还包括ProASIC3、 ProASIC Plus、 Axcelerator和RTAX-S。CorePWM现已开始供货,用户可从Actel网站下载免费的评测版。