创建完成工程之后,需要创建顶层实体。创建完顶层设计文件之后,使用SOPC Builder创建NIOS II 嵌入式处理器,添加、配置系统的外设IP,组成Nios II系统模块。 Nios II 系统模块设计完成之后要加入到该顶层实体中,然后进行其他片上逻辑的开发。& a6 G1 u! [1 t# ]! d
2.3.1 创建顶层实体
8 o( u U5 E+ e$ H/ G+ L5 f(1)新建的工程窗口中,选择FileNew; 6 U" H- J; Y) ?/ h7 ]. u$ n
(2)在Device Design File页中,选择Block Diagram/Schematic File,即原理图文件,也可以选择硬件描述语言的文件形式。单击OK。
! |/ G( D' L# U- j. U7 ^(3)出现一个模块编辑窗口。
8 I5 D5 J s2 g& Y( R1 p(4) 选择FileSave As,出现Save As对话框,显示的目录为之前设置的工程目录,文件名为之前设置的顶层实体名(由于这是工程的第一个文件,系统会默认为顶层设计实体的名字)。确定Add to Current Project选项被选中,点击Save文件被保存并被加入到工程中。 4 ?# T/ w0 W0 }) S1 A! b+ F
1 Y- w) V5 _8 ]7 |9 b2.3.2 创建Nios II系统模块: a) q8 z- c% |4 \6 K
创建NIOS II系统模块需要使用SOPC Builder,它是Quartus II中的一个工具,使用SOPC Builder可以创建一个Nios II 系统模块,或者创建多主设备SOPC模块。一个完整Nios II的系统模块包括Nios II处理器和相关的系统外设。所以创建系统模块的流程是先创建一个系统,然后添加Nios II CPU和外设IP,然后进行相应的设置,最后生成实例,然后将其加入到工程的顶层实体中去。
- j4 x- i9 F3 ^, n. n% F一、创建系统 , b* O: p0 ]$ A7 {# g( k3 l
启动SOPC Builder,选择ToolsSOPC Builder,出现图2-10的Create New System对话框。键入系统的名字,选择硬件描述语言Verilog或者是VHDL。 ) N- \( k6 N( x3 n8 P5 A
( c' C& e/ T/ H: e; w. x
- \; m' Y' K$ g: _6 z8 l) T0 G, p8 n5 D, b& O. S
二 、设置系统主频和指定目标FPGA & |3 J$ C* R3 m& N" Y
在Target栏中的Board部分指定我们这本书使用的核心开发板——Cyclone II (EP2C35)。也可以在Board部分选择Unspecified,然后在Device Family选择Cyclone II。 7 ?( J/ l( v6 \, v* R
用户需要设置系统的时钟频率,该频率用于计算硬件和软件开发中的定时,比如时钟分频或波特率。这里我们设成85MHz,还可以选择是否选用流水线。
^4 s0 \% P+ t三、加入Nios II CPU和 IP模块
% P3 ` \1 y" H! S, a2 x 首先加入Nios II软核,Nios II 是软核CPU,共有三种类型的CPU可供选择:Nios II/e(经济型)、Nios II/s(标准型)和Nios II/f(快速型)。用户可以根据实际的情况进行选择。Nios II是一个用户可以自行进行定制的CPU,用户可以增加新的外设、新的指令等。 ) U! z, m% y& q: R7 ~% ]5 i* ~
添加Nios II CPU的步骤如下:
/ [) L* q7 c1 Z4 ?+ L5 |1. Avalon Components 下面选择Nios II Processor; : P3 d* u( n* h/ f" R1 \
2. 点击 Add,出现Nios II CPU的配置向导,共有三种类型的CPU可供选择;
4 y- ^" G% t1 d6 ? 根据需要选择相应的一种Nios II核,我们选择标准型的Nios II核,Hardware Multiply选择none,不选择Hardware Divide点击Next,进入Caches & Tightly Coupled Memories设置窗口;
. d' [ X0 q( u 设置Nios II的Cache和与CPU直接相连的存储器端口(不通过Avalon总线),选择Instruction Cache为4Kbytes,不选中Include tightly coupled instruction master port(s) ,点击Next进入Advanced Features设置页面。 * y0 [. @4 n; y$ U
Advanced Features的设置页面是Quartus II 6.1 版本才有的设置,这里不选择Include cpu_resetrequest and cpu_resettaken signals点击Next进入JTAG Debug Module设置。 共有4个调试级别可供选择,这里选择Level1即可,该级别支持软件的断点调试。JTAG调试模块要占用较多的逻辑资源,如果整个系统调试完毕了可以选用No Debugger以减少系统占用资源点击Next进入自定义指令的设置。 & |* D& ~, c% @9 ?# V
因为本例不用到任何的自定义指令,这里不作任何的设置,点击Finish完成CPU模块的添加。 . D: R. b. S; a
. {4 v- ?" M" y除了Nios II CPU,电子钟设计需要添加的IP模块包括: - F! v' [7 e1 ~6 O0 r0 [1 w
Timer 2 Q* ]# m2 {: |& I: B" f$ R: ?- N5 T
Button PIO
" @( j* e4 @" dLCD控制器
* r0 G' |4 ~" w, s) ?External RAM Bus
( g$ e& k9 u c8 l6 GExternal Flash Bus
! w$ _: u- y/ g0 fExternal RAM interface : s6 L& |4 {( [* f: j7 K1 G
External Flash Interface
' m! r% F' W# ?6 M* K: f1. 添加定时器
2 z2 g2 U: `7 h1 a8 w3 N定时器和Nios II CPU一样,用户可以对其进 行定制。添加定时器的步骤如下:
4 `# e8 `4 |4 \) X, ^(1)在Avalon components下的other库中选 择Interval Timer并单击Add,Avalon_Timer-timer_0的向导窗口出现; 3 h2 Z- T2 Z# a' s" G: i/ r8 M
(2)配置定时器,点击Finish,完成定时器的添加。
) m9 V! l; z6 D% _/ A+ y9 A' t( U(3)可以对Timer进行重命名,我们这里取缺省的名字。 9 q" f3 q6 F- z0 R% ]7 p5 E
2. 添加Button PIO ( T. x4 \1 @9 ^% c; m
(1)在 Avalon components下的other下选择PIO,单击Add,出现Avalon PIO-PIO_0的向导; 9 i/ a- t. [$ N( T& R# x
(2)在Basic Settings页中,设置width=4bits,direction为Input Ports Only; 7 w2 M! _7 `, e& h. g! A3 E
(3)在Input Options页中,在Edge Capture Register下选中Synchronously Capture,然后选择Either Edge;
* Z6 ]7 W8 Z6 i. Z8 Z& j* o (4)在Interrupt下选中Generate IRQ,然后选择Edge;
7 @ Z1 L4 r3 c. f! ]0 |(5)点击Finish,返回到Altera SOPC Builder NIOS2的窗口; e; Z L. i/ s- Q9 I
(6)右键单击Module Name下的pio_0,从菜单选择rename,重命名为button_pio. 2 s0 r8 t; p( a7 d9 b( M
3. 添加LCD控制器 - J1 p2 `, L" \" X8 m5 r) u. g
(1)在图2-11的窗口中的左侧的Avalon components下的display库中选择Character LCD(162, Optrex 16027),单击Add;
" H; S% l2 Y' e5 r(2)Module Name下出现,lcd_16027_0;
" W7 A9 }+ {, ?' k5 L(3)将其重命名lcd_display。 3 T* O+ w3 F" V2 f% k1 X- _
4.添加外部RAM接口 * ^9 E7 j6 d9 B
(1)Avalon components下的Memory下面选择Cypress CY7C1380C SSRAM,单击Add,出现SSRAM (Cypress CY7C1380C)-ext_ssram的向导;
7 c$ f2 F* l0 @" R. F+ r" q(2)在Timing Parameters下面设置Read Latency 为2 clocks,在SSRAM下面设置Memory Size为2Mbytes
3 _5 I3 G$ W' B' E5 s+ F(3)单击Finish,返回到Altera SOPC Builder NIOS2的窗口;
* M$ Z+ d% b$ _ N(4)右键单击Module Name下的ssram_0,从菜单选择rename,重命名为ext-ssram。 1 g8 u) Q' E# G7 @6 k8 u
5. 添加外部闪存接口
# t4 J) i6 [2 w s3 b/ M(1)在Avalon components下的Memory下面选择Flash Memory(Common Flash Interface),单击Add,出现外部闪存接口向导;
: `3 w. F4 ~+ e6 v, r/ z0 G' J/ J+ H(2)在Attributes页中,可以在Presets列表中选择相应的闪存的接口,这些闪存的接口都是经过测试的,如果列表中没有,用户可以自己定义闪存的Size和Data Width; ( f9 D! T( L4 F# T4 ^6 F7 z$ D& \; b( u
(3)在timing页中,可以设置闪存的读写时序要求,可以设置Setup, Waite, hold时间等参数,通常保留缺省的设置;
1 d# Y% k4 \( @" {(4)如应用选择的闪存接口不在列表中,需要自己定义Size和Data Width,和时序要求; ' O4 X" R3 D+ \! y. d$ r
(5)点击Finish,返回到Altera SOPC Builder NIOS2的窗口,Module Name出现cfi_flash_0,对其重命名为ext_flash。
) q* h% N) D* ~# `" X0 B3 A6 a7 D+ V ) b6 r; g: M8 A. ]2 U% i' C6 S
6. 添加外部RAM总线和外部flash总线(Avalon三态总线桥) 8 @- \: O$ z5 k3 Q
为了使Nios II 系统能与开发板上的外部存储器通信,必须在Avalon总线和外部存储器之间加入Avalon三态桥。
$ v9 U8 h9 F( I) ]+ v( ?. t步骤如下:
% c1 ^5 @7 Q6 ^; y. D! S(1) 在Bridge下,选择Avalon Tri-State Bridge,点击Add,出现Avalon Tri-State Bridge – tri_state_bridge_0向导;
* \5 P2 D' ?# \+ v" ~( t(2) Registered选项默认为选中;
$ K# K/ H! P) }4 J- a) n8 Q9 m(3)单击Finish,返回到Altera SOPC Builder NIOS2的窗口;
- c# a9 E5 x ^1 k) s (4) 将其重命名为ext_ssram_bus; ( B& h! N( w2 ]: f: E
(5) 重复前三个步骤,在添加一个Avalon三态总线桥,并重命名为ext_flash_bus.
1 ~ Q/ L+ a& m$ } h3 d3 @0 L F7.添加JTAG UART . X6 F# D7 L9 K; v9 R
(1)在Avalon components下的Communication下选择 JTAG UART,点击ADD,出现添加向导。
+ z7 k, G8 G' X( Y1 }$ @(2)按照缺省设置,点击Finish。
/ j T3 u) g8 R- L7 t: ~( c( U(3) 将其重命名为JTAG_UART.
n0 d4 k7 f: E8 ?7 Y Q& J$ C8. Nios II系统的连接 ( m2 U- J r- y+ f
主要是外部RAM接口要和RAM的三态桥连接,外部的Flash接口要和flash的三态桥连接。所有添加的IP连接都是系统自动完成的,除了上面提到的三态桥和外部存储器的接口的连接之外,其它的连接用户不用修改,但对于三态桥和外部存储器接口的连接,系统的自动连接可能和用户的开发板不匹配,用户需要进行手动的更改。针对我们所用的开发板的情况进行的设置,因为本书用到的开发板外部的SRAM和外部的Flash没有使用共用的数据线和地址线,所以必须为它们分别添加一个三态桥。
2 e7 O }5 g, B2 {
' W* l& C; [' H8 S5 r! q; q5 [% G' e 2.3.3分配IP模块的地址和中断号 在以上添加IP的过程中,SOPC Builder为各个IP模块分配了一个默认的基地址,用户可以改变这些默认的分配。如果用户自己分配的地址出现冲突,SOPC Builder会给出警告,用户可以按照下面的步骤来进行分配和解决地址冲突问题。
, S. ]/ ~: i* _, c1 w7 d: o+ k' _下面我们给出一种自定义的地址分配实例,将闪存的基地址设定为0x00000000,步骤如下:
; [6 E1 L+ k% X2 I% P6 o; v+ D$ Q(1)单击Flash外设的Base栏,将地址改为0x0,然后回车,这时SOPC Builder的消息框中出现错误的提示信息,这是因为闪存的地址和其它的外设地址发生了冲突。 # y' @4 o+ O6 a8 Q/ @1 Y: i( G9 _8 Q
(2)选择Module菜单中的Lock Base Address操作,一个挂锁的图标出现在闪存基地址的旁边。 ! y& J/ R* Q/ G9 i( ]; J O+ Y
(3)选择System菜单中的Auto Assign Base Address操作,来解决外设的地址分配冲突问题,SOPC Builder调整其它外设的地址来避开与闪存地址的冲突,错误提示的消息就会消失了。
. Q* C$ @9 S0 \8 m* O. i(4)用户可以手动修改各个外设的中断号,中断号越低,中断优先级越高,用户也可以采用自动分配中断号,选择System菜单中的Auto Assign IRQs,但SOPC Builder不处理软件操作,采用自动分配中断的策略不一定是最优的,用户最好是根据自己的应用来确定外设的中断优先级,采用手动的分配。 . K" K( c: j5 i3 N% v: Q% ]
2.3.4 配置NIOS II 系统 系统的IP模块添加完成之后,还需要对系统进行配置。点击Nios II More “cpu_0” Settings 页,用户可以进行如下的设置:
! C. o8 T7 j7 P! G Reset Address:可以选择存放Boot Loader的存储器和设置Boot Loader在存储器中的偏移,我们这里选择ext_flash,偏移选择默认;
. }" M( k$ R. S- ]4 iException Address:可以选择存放异常向量表的存放的存储器和设置异常向量表在存储器中的偏移,我们选择ext_ssram,偏移选择默认; ; H6 F( u" p7 [2 n
Break Location:如果NIOS II 包含有一个JTAG Debug模块,SOPC Builder会显示这项内容。其Memory Module总是JTAG Debug Module,Offset 固定为0x20, 地址由JTAG debug module基地址决定。用户不能修改Break Location的各个域的内容。 6 P1 u9 m5 o; B/ z* g; P% x
2.3.5 生成NIOS II并加入到工程中 NIOS II系统是工程的一部分,我们首先是生成它,然后加入到工程中去,然后将整个工程下载到FPGA芯片中去。单击System Generation,在Option下进行如下的设置: 0 l5 _0 ]" _+ g. {3 U7 R7 j
选中 HDL,会生成系统模块的硬件语言文件。
% R$ S* c# ]. u, u选中 Simulation,如果安装了ModelSim软件,会生成用于仿真的相应的文件。
9 ^& ^, N7 a: F单击 Generate,SOPC Builder会提示生成系统的进程,系统生成完成时会提示”SUCCESS: SYSTEM GENERATION COMPLETED”。单击exit 退出SOPC Builder。
9 V& t. @+ S4 ?* q+ D6 [ 系统生成完成之后,SOPC Builder为这个定制的NIOS II系统模块创建了一个符号,要把Nios II系统加入到工程中去,遵循如下的步骤:
3 V; Z* q4 m% f' P/ |. r9 C: ~) q" h(1)在 Quartus II软件中,打开顶层实体(BDF格式),在BDF窗口中任意处双击,出现 Symbol对话框; 6 B, `0 C. ]5 a4 T% M( D# l
(2)在Symbol对话框中单击Project来展开工程目录,其下出现NIOS2(本例采用的系统名),选中它,右侧出现了系统的符号表示;
9 h% J4 s: e/ b, q U7 V: Z0 X(3)单击OK,Symbol对话框关闭,NIOS2的符号轮廓被附着在鼠标的指针上。
, @# m' Z' {% ?( ](4)BDF窗口中任意空白处单击一下,NIOS2的符号出现在BDF窗口中,这样我们创建的系统已经被加入到工程中了。
6 x* g; G x+ U: F9 h% N* {! A6 M, j# N% X
2.3.6 加入引脚和嵌入式锁相环 除了NIOS II系统之外,可能还要有其它的硬件逻辑,我们这里加入一个嵌入式锁相环,嵌入式锁相环有两个时钟输出,一个输出SSRAM提供时钟,另一个时钟的输出为NIOS II CPU提供时钟,然后添加输入、输出、双向引脚,以实现和FPGA外部的外设进行通信。
- n' `% e, n1 Z4 V. `4 p b加入嵌入式锁相环的步骤如下:
2 \% @' h$ M/ P7 @(1) 点击ToolsMegaWizard Plug-In Manager,出现MegaWizard Plug-In Manager向导Page1窗口,点击next 在MegaWizard Plug-In Manager Page2 窗口中的IO下面选择ALTPLL,器件选择Cyclone II,输出文件类型选择VHDL,文件名为ssram_pll,选中Return to this page for another create operation,然后点击Next,出现MegaWizard Plug-In Manager-ALTPLL [Page 3of 9]; $ i7 R8 l: ]4 K& w
在MegaWizard Plug-In Manager-ALTPLL [Page 4 of 10]窗口中,不做任何选择,点击next; - z1 }1 `; ?1 W! r1 U5 t
在MegaWizard Plug-In Manager-ALTPLL [Page 5 of 10]窗口中,单击next;
: Q" s/ X' |, t4 E: { 在MegaWizard Plug-In Manager-ALTPLL [Page 6 of 10]窗口中,设置c0输出时钟,首先选中Use this clock选项,设置时钟频率为85MHz,占空比为50%。点击Next会进入c1输出时钟的设置; 4 o3 D1 G) c1 f- }: n
嵌入式PLL可提供3个输出时钟,我们使用其中的两个,MegaWizard Plug-In Manager-ALTPLL [Page 7 of 10]窗口中,在c1时钟的设置页面上,选中Use this clock选项,设置时钟频率为85MHz,点击Next;
" W+ A- ~# i; @) P) H 在MegaWizard Plug-In Manager-ALTPLL [Page 8 of 10]窗口中,不选中Use this clock选项,即我们不使用c2时钟,点击Next; 3 Z! S7 v9 @: s# i) Q% m
在MegaWizard Plug-In Manager-ALTPLL [Page 9 of 10]窗口中,给出了用于仿真必须要产生的文件,点击Next;
& w8 W- R# g& Z& k! g" p在MegaWizard Plug-In Manager-ALTPLL [Page 10 of 10]窗口中,给出了用户选择要产生的文件,不做改变,采用默认配置,点击Finish完成PLL的生成。
6 L! P# F7 r) o在顶层实体的bdf窗口中双击鼠标,出现Symbol添加窗口,在project下面选择刚才建立的ssram_pll,点击OK。ssram_pll的轮廓会附着在鼠标上,点击bdf窗口的空白处,将嵌入式锁相环加入到了工程中。
0 ? W n8 U/ N7 @' k$ O! c引脚添加的步骤如下: 1 Q; b6 ]4 R8 Q
(1)在顶层实体的bdf窗口的空白处双击鼠标,出现Symbol添加窗口,在altera/quartus/libraries下面选择primitives,再在其下选择pin,在其中有三种类型的引脚,有bidir,input,output,分别为双向、输入和输出引脚,选择相应类型的引脚,点击OK。 * @7 `- X3 }! g% x
(2)点击bdf窗口的空白处,即将引脚加入到了工程中。 3 n% ?$ T# o: y1 @5 U% V2 S
(3)重复上面的步骤添加为各个端口添加相应类型的引脚。 8 v3 o6 d$ @5 c0 Z# c5 T
连接引脚和命名引脚 Z0 V; s$ |# W* W" m' X
第一个加入的引脚的名称缺省为pin_name,之后加入的引脚名称依次为pin_name1,pin_name2向上递增,为了便于理解和记忆,需要对引脚重新命名,使其和其传输的信号联系起来。
# t/ h4 N1 ~. B3 D% R3 b3 d1 ?命名引脚的方法如下: (1) 双击引脚的“pin_namen”部分,pin_namen的文字变成高亮,可以对其编辑。 0 a* q* i# ]3 @0 I% ^6 f
(2) 对其他的引脚重复以上的操作,修改成具有意义的名字。
$ \" Z+ i. k1 Y& g" Q# ?; g D(3) 对于总线型的引脚,引脚名称之后要标识出总线的位数,如ddr_a[12..0],在引脚名称之后加上方括号,然后写上最高位和最低位,用两个..隔开。
5 W4 x; h( X7 z6 ~' G" H6 N; j(4)将嵌入式锁相环和系统模块等连接起来,并将引脚连接到相应的端口上。
9 l1 p( Y9 D. a$ D/ [" k3 K/ H; M3 o1 K5 @
2 Z: J) Q# X5 t5 h
* r+ ^9 Y; B8 ] i2 |[ 本帖最后由 kenson 于 2009-1-23 14:17 编辑 ] |